后端总线 Back-side bus

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后端总线（BSB，Back Side Bus）：带有L2和L3缓存（Cache）的计算机中，负责中央处理器和外部缓存（经常为第二级缓存）之间的数据传递的数据信道。后端总线传输速率总是高于前端总线。用于处理缓存数据的后端总线实际上是以CPU时钟速度运行。在在90年代中期，后端总线曾是保持数据移动的重要路径。Intel公司的Pentium II和Pentium Pro都使用所谓的芯片外缓存，与保存在传统内存中的数据相比，这类缓存将经常使用的数据靠近（在访问数据所需的距离和时间上）主处理单元保存。连线将CPU连接到第二级（L2）缓存资源并以CPU时钟速度在CPU与L2缓存之间交换数据。AMD公司此后也开始采用同样的战略。

单词	Backside bus
释义	Backside bus 中文百科后端总线 Back-side bus （重定向自Backside bus）后端总线（BSB，Back Side Bus）：带有L2和L3缓存（Cache）的计算机中，负责中央处理器和外部缓存（经常为第二级缓存）之间的数据传递的数据信道。后端总线传输速率总是高于前端总线。用于处理缓存数据的后端总线实际上是以CPU时钟速度运行。在在90年代中期，后端总线曾是保持数据移动的重要路径。Intel公司的Pentium II和Pentium Pro都使用所谓的芯片外缓存，与保存在传统内存中的数据相比，这类缓存将经常使用的数据靠近（在访问数据所需的距离和时间上）主处理单元保存。连线将CPU连接到第二级（L2）缓存资源并以CPU时钟速度在CPU与L2缓存之间交换数据。AMD公司此后也开始采用同样的战略。英语百科 Back-side bus 後端汇流排（重定向自Backside bus） In personal computer microprocessor architecture, a back-side bus (BSB), or backside bus, is a computer bus used to connect the CPU to CPU cache memory, usually L2. If a design utilizes it along with a front-side bus (FSB), it is said to use a dual-bus architecture, or in Intel's terminology Dual Independent Bus (DIB) architecture.
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